Real-time processor debug system

   
   

A real-time processor debug system that selectively samples address and data signals of a virtual bus of a core processor during real-time operations to reduce power consumption and to minimize performance impact due to bus loading. Gating logic for an embedded processor provides the virtual bus signals of a core processor, including address and data signals, to a debug interface of an embedded system chip or integrated circuit (IC). The gating logic receives update data and update address signals from the debug interface to control switching on corresponding debug address and data buses. The core processor provides processor status signals to the debug interface so that the debug interface determines the particular transaction being performed by the core processor. The processor status signals indicate change of flow (COF) events as well as instruction fetch or data fetch cycles.

Un processeur en temps réel corrigent le système qui sélectivement des échantillons adresse et des signaux de données d'un autobus virtuel d'un processeur de noyau pendant des opérations en temps réel pour réduire la puissance d'énergie et de réduire au minimum l'impact d'exécution dû au chargement d'autobus. La logique de déclenchement pour un processeur incorporé fournit les signaux virtuels d'autobus d'un processeur de noyau, y compris l'adresse et les signaux de données, à une interface de correction d'un morceau de système ou d'un circuit intégré incorporé (IC). La logique de déclenchement reçoit des données de mise à jour et les signaux d'adresse de mise à jour de l'interface de correction pour commander la commutation sur correspondre corrigent des bus d'adresse et de données. Le processeur de noyau fournit des signaux de statut de processeur à l'interface de correction de sorte que l'interface de correction détermine la transaction particulière exécuté par le processeur de noyau. Les signaux de statut de processeur indiquent que le changement des événements de l'écoulement (COF) aussi bien que l'instruction cherchent ou les données cherchent des cycles.

 
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