Low power low voltage differential signal receiver with improved skew and jitter performance

   
   

A folder common cascode circuit with symmetric parallel signal paths from the differential inputs to the differential outputs provides a low skew, low jitter, low power differential amplifier. The signal paths on either side of the differential amplifier are made equal with equal loads along each path. Pairs of complementary NMOS and PMOS transistor pairs with parallel complementary biasing stacks on the output cascode circuitry maintain symmetrical parallel signal paths, amplification and impedance loading from differential input to differential output. Output voltage translating inverters provide a higher voltage level output signal while maintaining low skew and jitter.

Un circuito comune del cascode del dispositivo di piegatura con i percorsi del segnale paralleli simmetrici dagli input differenziali alle uscite differenziali fornisce un nervosismo obliquo e basso basso, amplificatore differenziale di alimentazione bassa. I percorsi del segnale da qualsiasi lato dell'amplificatore differenziale sono resi uguali con i carichi uguali lungo ogni percorso. Gli accoppiamenti accoppiamenti del transistore complementare di PMOS e di NMOS con le pile influenzanti complementari parallele sui circuiti del cascode dell'uscita effettuano i percorsi del segnale paralleli simmetrici, l'amplificazione ed il caricamento di impedenza dall'input differenziale ad uscita differenziale. Gli invertitori di traduzione di tensione dell'uscita forniscono un più alto segnale in uscita del livello di tensione mentre effettuano l'obliquità ed il nervosismo di livello basso.

 
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