Method and apparatus for a low latency source-synchronous address receiver for a host system bus in a memory controller

   
   

A method and apparatus for a source synchronous address receiver for a system bus is described. A flow-through between a system bus address input to a memory bus is controlled by two inputs: one is a source synchronous address strobe directing the receiver to latch the address and store data, while the other is a protocol signal, signaling the beginning of the address transfer. A flow-through circuit generates an enable signal in response to a digital address strobe signal and a digital address select signal to generate, prior to receipt of the address packet, an enable signal for a flow-through gate having the address packet and the enable signal as inputs. The flow-through gate provides the first component of the digital address packet (transaction address) to a chipset once the digital address packet appears on the address pin.

Une méthode et un appareil pour un récepteur synchrone d'adresse de source pour un autobus de système est décrite. A couler-à travers entre une adresse d'autobus de système entrée dans un autobus de mémoire est commandé par deux entrées : on est un stroboscope d'adresse synchrone de source dirigeant le récepteur pour verrouiller l'adresse et pour stocker des données, alors que l'autre est un signal de protocole, signalant le commencement du transfert d'adresse. A couler-à travers le circuit produit d'un signal de permettre en réponse à un signal numérique de stroboscope d'adresse et à un signal choisi d'adresse numérique pour se produire, avant la réception du paquet d'adresse, un signal de permettre pour a couler-à travers la porte ayant le paquet d'adresse et le signal de permettre comme entrées. Couler-à travers la porte fournit le premier composant du paquet numérique d'adresse (adresse de transaction) à un jeu de puces une fois que le paquet numérique d'adresse apparaît sur la goupille d'adresse.

 
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