A first-in first-out buffer (FIFO) with multiple outputs. The FIFO has an input for writing data into the FIFO. The FIFO has multiple outputs for reading the data out of the FIFO. Each output is independent from the other outputs, and can be used to read data from a different address at a different time using a different clock signal. In one embodiment, the FIFO is implemented as a storage array with circular pointers to repeatedly loop through the addressable locations. It includes a write pointer to indicate which address represents the input. It includes multiple read pointers to indicate which addresses represent the outputs. Overrun prevention logic is used to assure that the write pointer will not cause new data to be written into any address that has not been read by all outputs, and to assure that data will not be read from any address that has not been written into.

A primeiro- no primeiro-para fora amortecedor (FIFO) com saídas múltiplas. O FIFO tem uma entrada para dados da escrita no FIFO. O FIFO tem saídas múltiplas para ler os dados fora do FIFO. Cada saída é independente das outras saídas, e pode ser usada aos dados lidos de um endereço diferente em uma estadia diferente usando um sinal diferente do pulso de disparo. Em uma incorporação, o FIFO é executado como uma disposição do armazenamento com ponteiros circulares para dar laços repetidamente com as posições endereçáveis. Inclui um ponteiro da escrita para indicar que endereço representa a entrada. Inclui o múltiplo leu ponteiros para indicar que endereços representam as saídas. A lógica da prevenção do overrun é usada assegurar que o ponteiro da escrita não fará com que os dados novos estejam escritos em nenhum endereço que não for lido por todas as saídas, e assegurem que os dados não estarão lidos de nenhum endereço em que não for escrito.

 
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> Method and apparatus for accelerating instruction fetching for a processor

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