A dual-timer process control system (10) includes a process control timer (28) used to limit the number of iterations of a procedure whose duration is controlled by an iteration timer (22). At system (10) startup, the iteration timer (22), process control timer (28) and procedure are started. The iteration timer (22) times out after a first predetermined amount of time and provides an iteration stop signal to stop the procedure. The iteration timer (22) and procedure are started again if the process control timer (28) has not timed out. If the iteration timer (22) and the process control timer (28) have timed out, the process is performed n-1 additional times, where n is the minimum number of iterations of the procedure.

Un sistema de control de proceso del dual-contador de tiempo (10) incluye un contador de tiempo del control de proceso (28) usado al límite el número de iteraciones de un procedimiento que duración sea controlada por un contador de tiempo de la iteración (22). En el arranque del sistema (10), se comienzan el contador de tiempo de la iteración (22), el contador de tiempo del control de proceso (28) y el procedimiento. El contador de tiempo de la iteración (22) mide el tiempo hacia fuera después de que un primer predeterminara la cantidad de tiempo y proporcione una señal de parada de la iteración de parar el procedimiento. El contador de tiempo de la iteración (22) y el procedimiento se comienzan otra vez si el contador de tiempo del control de proceso (28) no ha medido el tiempo hacia fuera. Si el contador de tiempo de la iteración (22) y el contador de tiempo del control de proceso (28) han medido el tiempo hacia fuera, el proceso se realiza las épocas adicionales n-1, donde está el número n mínimo de las iteraciones del procedimiento.

 
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> Maintaining packet security in a computer network

> Invention to allow multiple layouts for a schematic in hierarchical logical-to-physical checking on chips

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